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[DRAM PHY] Layout Engineer

💰 취업축하금 50만원

기술스택

Python
Verilog
C

주요업무

• DRAM PHY Layout: Memory (LPDDR4/5, GDDR6/7, NAND) PHY Layout
• High-speed Transceiver Layout

자격요건

• 경력: 4년 이상 해당 전문 분야 종사
• 반도체 및 컴퓨터, 전기/전자학과 졸업자
• 해외 여행에 결격 사유가 없으신 분

[필요 스킬]
• High-speed Signal Layout
• FINFET Layout
• EMIR Verification

우대사항

• High-speed Transceiver 양산 및 테스트 경험 (유선, 무선)
• FINFET Layout 경험
• EMIR Verification 경험
• 직무 관련 양산 프로젝트 경험 우대
• 취업 보호 대상자 (보훈, 장애 등)는 관련 법령에 의거하여 우대

복지 및 혜택

• 업무 방식: 자율 출퇴근 (선택적 근로시간제), 자율적 업무 환경, 수평적 조직 문화 (영어 닉네임 사용)
• 근무 환경: 중식비 지원, 간식 및 음료 무한 제공, IT 바우처 지급
• 건강 관리: 단체 상해보험 가입, 의료비 지원, 종합 건강검진
• 자기계발: 도서 (업무/개인) 구입비 지원, 영어 학습비 지원
• 기타: 경조사 지원 (경조 휴가, 경조금, 상조 서비스 등), 명절 선물 지급, 생일 반차 제공

채용절차 및 기타 지원 유의사항

[채용 절차]
• 서류 접수 > 1차 직무 인터뷰 > 2차 리더십 인터뷰 > 최종 합격

[지원 서류]
• 이력서 1부 (자유 양식)

경력: 경력 4~15년

학력: 대학교졸업(4년) 이상

마감일: 2024-10-26

근무지역

서울 강남구 역삼로 114, 13층
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기업/서비스 소개

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오픈엣지 NoC (Network-on-Chip) 팀은 SoC의 모든 구성 요소를 연결하는 On-chip Network를 설계하는 팀입니다. 
최신 SoC에서 On-chip Network는 시스템 전반의 성능과 효율을 결정하는 가장 중요한 요소 중 하나입니다. 
또한 On-chip Network는 다양한 SoC 요구에 맞게 자유롭게 배치되고 구성되어야 합니다. 
따라서 NoC팀에서는 변형 가능한 스위치/네트워크 구성 요소를 개발, 구성 요소를 효과적으로 연결하고 최적화하는 소프트웨어를 개발합니다.


NoC팀에서 하드웨어 엔지니어로 일하면서 다양한 SoC 환경에 대응 가능한 유연성 있는 하드웨어 설계, 검증, 성능 분석과 더불어 소프트웨어와의 시너지를 경험할 수 있는 좋은 기회를 얻을 수 있습니다.

[DRAM PHY] Layout Engineer

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